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FPGA最大的設計挑戰

文章發表於 : 週六 6月 16, 2007 12:50 pm
eject
SIMULATION OK 到 FPGA 不 WORK
一片 FPGA WORK 另一片不 WORK
FPGA WORK 到 ASIC 不 WORK

不過最慘的應該是
昨天 WORK 今天 Burn-in Fail...
然後 LAYOUT 小姐告訴你... APR 跑完了 !?

後來下午發現是 FPGA 的問題
下班前採購小姐告訴你
FPGA 代理商說 "現在下單從美國回來要12週"
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Re: FPGA最大的設計挑戰

文章發表於 : 週五 8月 17, 2007 3:54 pm
chris
所以每次實驗的時候 要先供奉FPGA一下, 祈求不要......罷工